| 基于系数可调FFE的10Gb_s发送端的设计 |
| 陈功;贺林;刘登宝; |
| 关键词：串行解串器;高速;发送端;FFE;真单相时钟 |
| 主要内容：采用SMIC 40nm CMOS工艺,设计了一种工作在10Gb/s的SerDes高速串行接口发送端电路,并创新性地提出了一种系数可调的FFE结构,使电路能适用于不同衰减的信道。电路主要模块为复接器、3阶FFE均衡器。复接器采用经典半速率结构 |
| 《微电子学》 2016,46(03):356-359 |
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